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交錯式功率級--不再僅適用于降壓轉(zhuǎn)換器
- 引言對那些為最新式電腦中央處理器 (CPU) 提供動力的穩(wěn)壓模塊 (VRM),電源設計人員過去一直采用多相交錯式降壓轉(zhuǎn)換器。上述 VRM 經(jīng)過精心設計,可滿足嚴格的 Pentium4 及 Athalon CPU 的穩(wěn)壓與瞬態(tài)要求。交錯式降壓轉(zhuǎn)
- 關(guān)鍵字: 轉(zhuǎn)換器 適用于 不再 功率 交錯
適用于語音通信和數(shù)據(jù)通信的新型電源系統(tǒng)
- 在優(yōu)化的電源方案設計時要考慮五個因素:即效率、方案大小、易用性、性能及散熱性。效率是應用同步開關(guān)穩(wěn)壓器與多輸出穩(wěn)壓器;方案大小是指線性穩(wěn)壓器、開關(guān)電容器穩(wěn)壓器、高集成度開關(guān)穩(wěn)壓器及多輸出穩(wěn)壓器;而易用性是指線性穩(wěn)壓器、SIMPLESWITCHER與高集成度開關(guān)穩(wěn)壓器;性能是指大電流控制器、高集成度開關(guān)穩(wěn)壓器與多輸出穩(wěn)壓器;散熱性是指散熱管理IC。
- 關(guān)鍵字: 電源 系統(tǒng) 新型 數(shù)據(jù)通信 語音 通信 適用于
適用于12 bit流水線ADC采樣保持電路的設計
- 本文設計了一個可用于12 bit,20 MS/s流水線ADC中的采樣/保持電路。該電路使用CSMC公司的0.5μm CMOS工藝庫,在20 MS/s采樣頻率下,當輸入信號的頻率為9.8193 MHz時,SFDR為76 dB,精度達0.012%,完全滿足12 bit要求。本文運用增益增強型折疊式運算放大器,以獲得較高的增益和帶寬。同時采用柵壓自舉開關(guān),并通過對電路中的開關(guān)組合優(yōu)化,極大的提高了電路的線性性能;采用全差分結(jié)構(gòu)、底極板采樣來消除電荷注入和時鐘饋通。該采樣保持電路能夠直接應用于高速高精度模/數(shù)轉(zhuǎn)換
- 關(guān)鍵字: 保持 電路 設計 采樣 ADC bit 流水線 適用于
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