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EEPW首頁(yè) >> 主題列表 >> 線(xiàn)性卷積

基于FPGA的線(xiàn)性卷積的實(shí)時(shí)實(shí)現(xiàn)

  • 摘要：從實(shí)際工程應(yīng)用出發(fā)，研究了在基于FPGA上快速傅里葉變換實(shí)現(xiàn)線(xiàn)性卷積的方法，并搭建了一個(gè)基于A(yíng)ltera的EP2S60硬件處理平臺(tái)，利用Altera提供的FFT IP核，在100 MHz系統(tǒng)時(shí)鐘下，數(shù)據(jù)吞吐率可達(dá)100 Ms／s，
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  • 關(guān)鍵字： FPGA  線(xiàn)性卷積    
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線(xiàn)性卷積介紹

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