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核內(nèi)路由 文章 進入核內(nèi)路由技術社區(qū)

一種高效網(wǎng)絡接口的設計

  • 為了得到比傳統(tǒng)片上網(wǎng)絡的網(wǎng)絡資源接口(NI)更高的數(shù)據(jù)傳輸效率和更加穩(wěn)定的數(shù)據(jù)傳輸效果，提出了一種新的高效網(wǎng)絡接口的設計方法，并采用Verilog HDL語言對相關模塊進行編程，實現(xiàn)了高效傳輸功能，同時又滿足核內(nèi)路由的設計要求。最終通過仿真軟件Xilinx ISE Design Suite 12．3和ModelSim SE 6．2b得到了滿足設計要求的仿真結(jié)果。
  • 關鍵字： 片上網(wǎng)絡  網(wǎng)絡資源接口  核內(nèi)路由  Verilog HDL  
共1條 1/1 1

核內(nèi)路由介紹

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