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EEPW首頁(yè) >> 主題列表 >> 數(shù)乘累加

基于FPGA的改進(jìn)型FIR濾波器的實(shí)現(xiàn)

  • 利用分布式算法對(duì)FIR濾波器的硬件實(shí)現(xiàn)進(jìn)行了探討，在數(shù)乘累加的理論上，對(duì)分布式算法的串行、并行和拆分查找表法的FPGA硬件實(shí)現(xiàn)方法進(jìn)行了研究。結(jié)合FPGA查找表結(jié)構(gòu)，兼顧資源及運(yùn)行速度的要求，用拆分查找表的方法設(shè)計(jì)了16階8位常系數(shù)FIR濾波器，并在Quartus II 5.0下進(jìn)行仿真，仿真結(jié)果驗(yàn)證了該算法的有效性和實(shí)時(shí)性。
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數(shù)乘累加介紹

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