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基于FPGA的高速導航解算硬件實現(xiàn)

  • 摘要：針對現(xiàn)有小型無人機導航系統(tǒng)的解算速度慢、多處理器核心臃腫可靠性差的缺點，實現(xiàn)了一種僅使用單一FPGA作為數(shù)據(jù)處理核心的小型高速導航解算系統(tǒng)。該系統(tǒng)對飛機運動方程組和導航方程組進行并行化分解，對相互獨
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一種于FPGA的高速導航解算系統(tǒng)設(shè)計與實現(xiàn)

  • 　　摘要：針對現(xiàn)有小型無人機導航系統(tǒng)的解算速度慢、多處理器核心臃腫可靠性差的缺點，實現(xiàn)了一種僅使用單一FPGA作為數(shù)據(jù)處理核心的小型高速導航解算系統(tǒng)。該系統(tǒng)對飛機運動方程組和導航方程組進行并行化分解，對相互獨立的中間變量進行并行計算，使得單個運算周期能夠同時進行6次浮點運算，在不盲目增加硬件消耗的條件下有效提高了解算速度。仿真和實驗結(jié)果表明系統(tǒng)能夠高效地進行導航信息解算，在小型無人機的導航控制領(lǐng)域有重要的工程應(yīng)用價值。 　　導航解算是小型無人機導航控制的基礎(chǔ)，小型無人機機動性強，為了完成自主導航任務(wù)，必
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導航解算介紹

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