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EEPW首頁 >> 主題列表 >> 同步數(shù)據(jù)采集

基于ARM/FPGA的高速同步數(shù)據(jù)采集方案

  • 　　大多數(shù)的勘探、觀測(cè)工作都是在嚴(yán)苛的環(huán)境中進(jìn)行的，對(duì)數(shù)據(jù)的準(zhǔn)確性、實(shí)時(shí)性都有著較高的要求，并且大多情況 ...
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基于FPGA多通道同步數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

  • 　引言　　數(shù)據(jù)采集在工業(yè)測(cè)控領(lǐng)域里有廣泛的應(yīng)用，它已成為計(jì)算機(jī)測(cè)控系統(tǒng)的一個(gè)重要的環(huán)節(jié)，尤其在設(shè)備故障監(jiān)測(cè)系統(tǒng)中，由于各種設(shè)備的結(jié)構(gòu)復(fù)雜，運(yùn)動(dòng)形式多種多樣，發(fā)生故障的可能部位很難確定，因此我們需要從設(shè)
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多路跟蹤濾波同步數(shù)據(jù)采集系統(tǒng)的研究

  • 介紹了采用高速硬件鎖相環(huán)技術(shù)，對(duì)多路相關(guān)聯(lián)信號(hào)同時(shí)、同步整周期均勻采樣和抗混疊跟蹤濾波的實(shí)現(xiàn)方法。給出了基于此方法由TMS320LF2407和AD73360L構(gòu)成的多路數(shù)據(jù)采集與處理系統(tǒng)。提出一種不同結(jié)構(gòu)的同步串行口接口
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一種多路同步數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  • 繼電保護(hù)或者測(cè)控裝置都需要同步采集多路的電壓或者電流信號(hào)，現(xiàn)在一般的實(shí)現(xiàn)方式都是用多路逐次逼近型ADC（譬如AD7656或者ADS8-556）實(shí)現(xiàn)多路同步數(shù)據(jù)的采集，這種方案采樣速度高、控制簡(jiǎn)單，但是每一通道都需要
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多通道同步數(shù)據(jù)采集及壓縮系統(tǒng)的設(shè)計(jì)方案

多通道同步數(shù)據(jù)采集及壓縮系統(tǒng)

  • 1 引言
    現(xiàn)代遙測(cè)系統(tǒng)中為了盡可能少地占用傳輸時(shí)間和存儲(chǔ)空間，在有限的信道容量?jī)?nèi)傳輸更多的有用信息，采用數(shù)據(jù)壓縮技術(shù)，有助于降低功率和帶寬要求，改善通信效率。這里提出一種基于DSP與CPLD的多通道同步數(shù)據(jù)
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基于FPGA的多通道同步數(shù)據(jù)采集存儲(chǔ)系統(tǒng)

  • 1 引言
    在現(xiàn)代信號(hào)處理系統(tǒng)中，多通道數(shù)據(jù)采集存儲(chǔ)系統(tǒng)廣泛應(yīng)用于各種商用以及工業(yè)領(lǐng)域中，特別是在艦上系統(tǒng)、彈上設(shè)備及艦上部分系統(tǒng)中，往往產(chǎn)生寬帶信號(hào)或上升沿下降沿較陡的模擬信號(hào)。對(duì)這樣的模擬信號(hào)往往
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基于USB總線的多路同步數(shù)據(jù)采集系統(tǒng)

  • 本文針對(duì)計(jì)算機(jī)外設(shè)通過通用串行總線（USB）接口接入問題，設(shè)計(jì)了USB總線的數(shù)據(jù)同步采集系統(tǒng)，配以相應(yīng)USB接口驅(qū)動(dòng)程序，可實(shí)現(xiàn)各種計(jì)算機(jī)外設(shè)即插即用地接入。
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CPLD在多路高速同步數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

  • 采用VHDL語言設(shè)計(jì)，用CPLD控制模/數(shù)轉(zhuǎn)換電路，完成多路模擬輸入的高速同步數(shù)/模轉(zhuǎn)，具有容錯(cuò)和自檢能力。
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同步數(shù)據(jù)采集介紹

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