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EEPW首頁 >> 主題列表 >> 加權(quán)均值算法

基于FPGA的四通道視頻縮放引擎的研究及設(shè)計(jì)

  • 設(shè)計(jì)了一種可實(shí)現(xiàn)4路視頻信號(hào)縮放和幀率轉(zhuǎn)換的電路架構(gòu)。視頻信號(hào)依次經(jīng)過縮小模塊、幀率轉(zhuǎn)換模塊以及放大模塊，有效地減少了幀率轉(zhuǎn)換對(duì)存儲(chǔ)器帶寬的需求。
  • 關(guān)鍵字： 幀率轉(zhuǎn)換  加權(quán)均值算法  FPGA  
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加權(quán)均值算法介紹

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