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EEPW首頁 >> 主題列表 >> 串并轉換

FPGA系統(tǒng)設計原則和技巧之：FPGA系統(tǒng)設計的3種常用技巧

  • 輸入的數(shù)據(jù)經(jīng)過選擇開關后，分別進入緩沖模塊1和緩沖模塊2。當數(shù)據(jù)寫入緩沖模塊1的時候，數(shù)據(jù)處理單元從緩沖模塊2讀取數(shù)據(jù)進行處理；當數(shù)據(jù)寫入緩沖模塊2的時候，數(shù)據(jù)處理單元從緩沖區(qū)模塊1讀取數(shù)據(jù)進行處理。
  • 關鍵字： FPGA系統(tǒng)設計  緩沖模塊  乒乓操作  串并轉換  流水線處理  

D／A轉換在System View環(huán)境下的仿真及硬件實現(xiàn)

  • 摘要 針對模擬信號在傳輸介質中優(yōu)于數(shù)字信號，而設計數(shù)模轉換模塊。首先用System View對DAC模塊進了仿真。然后設計的D/A轉換的硬件電路。通過設計了一個前置的串并轉換電路，不僅可以實現(xiàn)8位并行數(shù)字信號的D/A轉換，
  • 關鍵字： 權電流  串并轉換  低通濾波  

基于FPGA的雙通道汽車渦輪增壓葉片溫度采集卡研制

  • 摘要：一種應用于汽車渦輪增壓器葉片溫度檢測的雙通道數(shù)據(jù)采集卡，該卡由峰值檢測、串行A/D構成模擬電路和由FPGA構成整個數(shù)字電路而組成。重點設計了FPGA內部串并轉換電路和FIFO，經(jīng)仿真和實驗驗證，串并轉換和FIFO的
  • 關鍵字： FPGA  串并轉換  FIFO  仿真  

基于CPLD的串并轉換和高速USB通信設計

  • 濾波和抗干擾是任何智能儀器系統(tǒng)都必須考慮的問題。在傳統(tǒng)的應用系統(tǒng)中，濾波部分往往要占用較多的軟件資源和硬件資源。復雜可編程邏輯器件(CPLD)的出現(xiàn)，為解決這一問題開辟了新的途徑，采用CPLD實現(xiàn)濾波是一種高效
  • 關鍵字： CPLD  USB  串并轉換  通信設計    

四種常用FPGA/CPLD設計思想與技巧

STM-1并行幀同步系統(tǒng)的設計與FPGA實現(xiàn)

四種常用FPGA/CPLD設計思想與技巧之流水線操作

四種常用FPGA/CPLD設計思想與技巧之串并轉換

AT24系列存儲器數(shù)據(jù)串并轉換接口的IP核設計

  • 介紹用VHDL語言設計該存儲器數(shù)據(jù)串并轉換接口的IP核，從而通過硬件（FPGA或其他可編程芯片）實現(xiàn)AT24系列存儲器與8位微處理器之間的并行通信。
  • 關鍵字： AT  24  存儲器數(shù)據(jù)  串并轉換    
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串并轉換介紹

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